ANSYS 데이 2017

2017년 10월 5일(목)~6일(금)

그랜드 닛코 도쿄 오다이바

우편번호 135-8701 도쿄도 미나토구 다이바 2-6-1

안시스 재팬(주)

・일시: 10월 5일(목) 16:30-17:00

・세션 번호: G-6

・주제: 저 ESL 커패시터를 활용한 소음 감소 검증 및 적용

・개요: 인터넷 도박 사이트 회로 기판의 LSI 전원 노이즈 및 그에 따른 방사 노이즈를 억제하기 위해 LW 리버스형, 3단자 등

의 낮은 ESL 커패시터　　　　 사용됩니다 힘

무결성 매개변수(Z11, Z21)의 실제 측정과 인터넷 도박 사이트기장 시뮬레이션을 통해 검증된 결과를 소개합니다

또한, 반도체 및 일반 2단자 캐패시터가 탑재된 다양한 종류의 보드에 대한 실제 방사 노이즈

測と시뮤레이션を行い、Z11やZ21等との同斢性を検討した結果もご案内いたしまс。

・날짜: 10월 5일(목)

・주제: 고속 LSI/EMC 호환 보드 개발 솔루션

・요약: 보드 개발 중 실제 측정 및 시뮬레이션을 활용하는 최신 엔지니어링 서비스 소개

이를 적용한 실제 장치에는 12G-SDI 및 16Gbps-FPGA, DDR4-SDRAM과 같은 고속 직렬 전송이 포함됩니다

등 고속병렬전송 및 EMC 검증 데모보드를 전시합니다 FPGA 장착 보드의 경우 FMC

코네크타백크프레인은 16Gbps를 지원하는 코네크타를 사용했습니다

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